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Vieux 16/05/2006, 15h59   #21 (permalink)
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Ca me rapelle les cours tout ca
Excellent taf
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Vieux 16/05/2006, 16h16   #22 (permalink)
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C'est pas facile à aborder comme sujet, je me souviens de mon prof qui ne comprenait rien aux pipelines mais essayait tout de meme de nous expliquer...

Bo boulot Jack
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Vieux 26/10/2011, 18h13   #23 (permalink)
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Après un déterrage au Bulldozer: Bin la partie Dual Core elle y est pas?

Blague à par, j'aurais bien aimé la lire.
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Vieux 26/10/2011, 20h58   #24 (permalink)
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Quand je les relis avec le recul, je me rends compte que j'avais quand même fait des raccourcis très ... raccourcis

Beaucoup de choses ont changées aujourd'hui.

Le prefetch est encore mieux geré ... la taille de la mémoire aidant.

Le nombre d'instructions executées simultanément par cycle n'est plus forcement d'une seule ...

De nouveaux set d'instructions viennent completer ceux deja existants, et qui aident dans bien des cas SSSE3, SSE4, AES-NI, AVX ...

Le controlleur mémoire est integré chez tout le monde.

La mémoire cache est partagée, de manière differentes selon les constructeurs certes, entre les coeurs de processeurs.

Etant donné qu'ils ne peuvent plus monter en frequence comme ils le veulent, ils augmentent les coeurs pour compenser. Mais viens le probleme de la bande passante mémoire, mais surtout la communication entre les coeurs qui deviens problématique.
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Vieux 26/10/2011, 21h58   #25 (permalink)
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Envoyé par jack Voir le message
Quand je les relis avec le recul, je me rends compte que j'avais quand même fait des raccourcis très ... raccourcis
C'est ça qui est bon. C’est beaucoup plus facile de voir des personnes parler vachement technique, où on comprend pas grand chose, que de personnes essayant que le max de monde possible comprennent les choses (même si c’est très raccourci).
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